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ST H7 定时器事件更新触发DMA加速数据传输-综合
1 定时器初始化(并没有绑定输出端口) 2 DMA定时器UP更新触发DMA传输(定时器关联DMA) 3 DMA中断回调函数 4 主函数使用 adc板级支持包 主函数
ST H7 FMC SDRAM外部内存访问分析-综合
1 STM32H743xx 系列 STM32H743xx 系列芯片都带有 FMC 接口,即可变存储存储控制器,能够与同步或异步存储器、SDRAM 存储器和 NAND FLASH 等连接,STM32H7
ST H7 ADC应用之定时器触发配合DMA双缓冲-综合
STM32 H7的ADC应用之定时器触发配合DMA双缓冲STM32 H7的ADC应用之定时器触发配合DMA双缓冲STM32 H7的ADC应用之定时器触发配合DMA双缓冲STM32 H7的ADC应用之定
ST F4 的 ADC1,ADC2 和 ADC3 可以组成三ADC 模式
ST F4 的 ADC1,ADC2 和 ADC3 可以组成三ADC 模式ST F4 的 ADC1,ADC2 和 ADC3 可以组成三ADC 模式ST F4 的 ADC1,ADC2 和 ADC3 可以组
ST H7之定时器高精度微秒级定时实现
H7之定时器高精度us级定时实现 H7之定时器高精度us级定时实现 H7之定时器高精度us级定时实现 H7之定时器高精度us级定时实现 H7之定时器高精度us级定时实现 H7之定时器高精度us级定时实
嵌入式ARM芯片CAN 2.0&CAN FD总线控制器综合2
1 FDCAN STM32H7 的 CAN FD 符合 ISO 11898-12015 标准,符合 CAN 协议 2.0 版 A,B 可访问的 10 KB RAM 内存,最多可分配 2560 个字。
MDMA块传输性能测试及缓冲传输+JPEG解码技术-综合
1 MDMA2D 块传输性能测试1 MDMA2D 块传输性能测试1 MDMA2D 块传输性能测试1 MDMA2D 块传输性能测试1 MDMA2D 块传输性能测试1 MDMA2D 块传输性能测试1 MD
DMA2D 数据传输及2D图形加速功能-综合
1 DMA2D 数据传输存储器到存储器模式 1.1 前景层作为DMA2D输入(000) 1.2 前景层和背景层作为DMA2D输入,且支持颜色格式转换和颜色混合(010) 前景层,背景层采用ARGB88
ST H7 DAC定时触发基于DMA请求触发技术-综合
1 DAC定时触发 DAC基础知识 1.2 DAC 支持的触发源 1.3 配置定时器6,用于触发DAC。 1.4 DAC采用 TIM6 作为触发源 2 DMA请求触发 3 DMA同步触发
面向嵌入式的摄像头软件设计
1 摄像头及屏幕关联主函数设计 2 摄像头驱动设计 2.1 配置DCMI相关参数 2.1 配置 DMA 相关参数 启动DMA传输,连续模式 启动DMA传输,快照模式,传输一帧图像后停止 摄像头控制
面向嵌入式的屏幕硬件设计
1 SPI屏硬件设计1 SPI屏硬件设计1 SPI屏硬件设计1 SPI屏硬件设计1 SPI屏硬件设计1 SPI屏硬件设计1 SPI屏硬件设计1 SPI屏硬件设计
ST ARM高级定时器PWM输出模式
1 PWM输出模式 2 程序实现1 PWM输出模式 2 程序实现1 PWM输出模式 2 程序实现1 PWM输出模式 2 程序实现1 PWM输出模式 2 程序实现
ST MP157 存储分配深入分析(含多核异构)
1 A7 设备启动时ROM及内存使用分配 A7固化ROM CODE A7使用RAM运行FSBL镜像 MP1 Linux 启动流程 现在很多产品对设备上运行的应用都提出了安全要求,STM32MP1启动
ST H7 ARM 三种低功耗模式-综合
 2 基于Systick滴答定时器的多组软件定时器实现 3 TCM,SRAM等五块内存的超方便使用方式(V1.1) 4 006_TCM,SRAM等五块内存的动态内
ST H7 LVGL UI系统移植基于LTDC液晶驱动-综合
1 串行SPI Flash W25QXX读写例程(查询方式) 2 QSPI读写例程,四线DMA方式,读每秒48MB 3 DMA2D功能测试(显示色块,位图,Alpha混合和图片混合等) 4 V7-03
ST H743 显示设备及FMC外设8080时序深入分析-综合
1 ST H743 FMC外设 1.1 FMC 接口 STM32H743xx 系列芯片都带有 FMC 接口,即可变存储存储控制器,能够与同步或异步存储器、SDRAM 存储器和 NAND FLASH 等
面向嵌入式字模液晶及显示字符原理-综合
1 从子模开始 1.1 GB2312 标准 首先定义的是 GB2312 标准。它把 ASCII 码表 127 号之后的扩展字符集直接取消掉,并规定小于 127 的编码按原来 ASCII 标准解释字符。
ST H743 双AD+双DMA与MPU内存区域管理深入分析
1 MPU# 内存分配问题 当前芯片厂商出的 M7 内核芯片基本都做了一级 Cache 支持,Cache 又分数据缓存 D-Cache 和指令缓冲 I-Cache,STM32H7 的数据缓存和指令缓存
ST MP157 IPCC 虚拟串口的异核通讯-AMP综合
总纲 IPCC 是 STM32MP157 硬件层的异核通讯接口,Mailbox 就是软件层的异核通讯框架,RP Msg 是异核间共享内存的框架。 那么它们三者有啥关系? 在 STM32MP157 里通
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