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  • FPGA/ASIC笔试面试题集锦（1）知识点高频复现练习题
    ASIC全称： Application Specific Integrated Circuit，是一种为专门目的而设计的集成电路。 现代ASIC常包含整个32-bit处理器,类似ROM、RAM、EEPROM、Flash的存储单元和其他模块. 这样的ASIC常被称为SoC(片上系…
    代码规范
    FPGA/ASIC笔试面试题集锦（1）知识点高频复现练习题
  • FPGA 时序控制及模块设计思想-串口综合
    1 系统设计（顶层模块、接收模块、发送模块和数据环回模块） 整个工程包括四个模块，顶层模块、接收模块、发送模块和数据环回模块 2 顶层模块 3 环回设计（接收数据完毕后，直接转为发送数据） 4 发送模
    后端
  • FPGA——*Verilog实现的边沿检测功能**含Modelsim仿真*
    边沿检测 ： 检测输入信号，或FPGA内部逻辑信号的跳变，即上升沿或者下降沿的检测。一个直接的方法：设置两个寄存器，对前一状态和后一状态进行寄存，若前后两个状态不同，则检测到了边沿，对于上升沿还是下降沿的确定可以用组合逻辑比较来确定。若前一状态为高电平，后面状态为低电平，则为下降...
    CSS
  • Verilog基础：语法、建模与案例，FPGA入门竟如此简单？
    一起养成写作习惯！这是我参与「掘金日新计划 · 4 月更文挑战」的第13天，本期带来最全Verilog教程，涵盖基础语法、硬件建模方法以及两个开源案例，快速入门FPGA开发
    嵌入式 人工智能
    Verilog基础：语法、建模与案例，FPGA入门竟如此简单？