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[2] Holden_Liu–代表作品 《UVM设计模式》
[3] pianshen1:UVM 通信篇TLM– UVM 通信篇TLM
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[6] pianshen1:System Verilog语法
[7] bleauchat :验证/脚本/总线等
[8] uvm设计分析——系列: 设计模式
[9] kevindas : 验证工程师的博客 行文思路比较通俗易懂–good
[10] IC Talking公众号 : systemverilog
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